EDA频率计课程设计报告

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1、 E D A E D A 频频 率率 计计 课程设计报告课程设计报告 专专 业：业： 电电 子子 信信 息息 工工 程程 班班 级：级： 电电 信信 0 9 0 1 姓姓 名：名： * 指导教师：指导教师： * * 2 0 1 2 年年 6 月月 04 日日 1 目目 录录 一、课程设计题目描述和要求一、课程设计题目描述和要求2 2 二、课程设计报告内容二、课程设计报告内容3 3 三、总结三、总结5 5 附附 录录6 6 参考书目参考书目8 8 2 引引 言言 在电子技术中，频率是最基本的参数之一，并且与许多电参量的测量方案、 测量结果都有十分密切的关系，因此频率的测量就显得更加重要。 数字频

2、率计是数字电路中的一个典型应用，实际的硬件设计用到的器件较 多，连线比较复杂，而且会产生比较大的延时，造成测量误差、可靠性差。随着 现场可编程门阵列 FPGA 的广泛应用，以 EDA 工具作为开发手段，运用 VHDL 等硬 件描述语言语言，将使整个系统大大简化，提高了系统的整体性能和可靠性。 一、课程设计题目描述和要求一、课程设计题目描述和要求 1.1、课程设计题目描述 1) 设计一个能测量方波信号的频率的频率计。 2) 测量的频率范围是0999999Hz。 3) 结果用十进制数显示。 4) 按要求写好设计报告。 1.2、课程设计要求 1) 脉冲信号的频率就是在单位时间内所产生的脉冲个数，其表

3、达式为，f 为被测信号的频率，N为计数器所累计的脉冲个数，T为产生N个脉冲所需的 时间。所以，在1秒时间内计数器所记录的结果，就是被测信号的频率。 2) 被测频率信号取自实验箱晶体振荡器输出信号，加到主控门的输入端。 3) 再取晶体振荡器的另一标准频率信号， 经分频后产生各种时基脉冲： 1ms， 10ms，0.1s，1s等，时基信号的选择可以控制，即量程可以改变。 4) 时基信号经控制电路产生闸门信号至主控门，只有在闸门信号采样期间 内(时基信号的一个周期)，输入信号才通过主控门。 5) f=N/T，改变时基信号的周期T，即可得到不同的测频范围。 6) 当主控门关闭时，计数器停止计数，显示器显示记录结果，此时控制电 路输出一个置零信号，将计数器和所有触发器复位，为新的一次采样做好准 备。 3 二、课程设计报告内容二、课程设计报告内容 1、频率计设计原理 在电子技术中，频率是最基本的参数之一，并且与许多电参量的测量方案、 测量结果都有十分密切的关系，因此，频率的测量就显得更为重要。测量频率的 方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速，以及 便于实现测量过程自动化等优点，是频率测量的重要手段之一。 数字式频率计的测量原理有两类：一是直接测