现代测试课程设计--高速数字锁相环路设计
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1、 1 前前 言言 锁相环路(PLL)是一个相位误差控制系统,是将输入信号(参考信号)和输出信号之间 的相位进行比较,产生相位误差电压来调整输出信号的相位,使输出信号频率与参考信号频 率相同。 信号锁相技术广泛应用于自动化控制等领域。利用该技术可以产生同步于被锁输入信号 的整数倍频或者分数倍频的输出控制信号。锁相环的基本结构是由鉴相、环路滤波、可控振 荡器和 M 倍分频等模块组成的一个反馈环路。输入的被锁信号首先与同步倍频信号经过 M 倍 分频后产生的锁相信号进行鉴相处理,输出相位误差信号。环路滤波模块通常具有低通特性, 它将相位误差信号转化为稳定的控制信号,从而控制可控振荡器模块,产生稳定的频
2、率信号 输出。这个频率信号就是所需的同步倍频信号。如果整个反馈环路锁相稳定,锁相环输出的 同步倍频信号的频率就是其输入的被锁信号频率的 M 倍。假如被锁信号在输入鉴相模块之前 又先被分频了 L 倍,则锁相获得的同步倍频信号的频率就是被锁信号频率的 M/L 倍。 锁相环路的应用十分广泛。在稳频技术中的应用,如:锁相倍频器,锁相分频器,锁相 混频器,锁相合成器等;在调制解调技术中的应用,如:锁相调频和鉴频,同步检波等。除 了以上所介绍的锁相环路的应用外,它还应用于空间技术(例如,由于各种原因使地面接收 的空间信号十分微弱,采用锁相接收机可使接收机接收微弱空间信号的能力大大加强)等方 面。由于锁相环
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